Pospeševanje množenja matrik z vezjem FPGA in razvojnim okoljem VitisLjubotina, Miloš (Avtor) Žemva, Andrej (Mentor) Biasizzo, Anton (Komentor) programirljivo polje logičnih vratmnoženje matrikVitis Unified Software Platformsistolično poljepospeševanje algoritmovnačrtovanje digitalnih vezijNamen tega dela je ovrednotiti programsko okolje Vitis Unified Software Platform za pospeševanje opravil, kot je množenje matrik. V vezju FPGA na razširitveni kartici PCI-e v gostiteljskem računalniku je z omenjenim orodjem implementiran sistem za množenje matrik. Njegova zmogljivost je primerjana z zmogljivostmi dveh obstoječih rešitev, Vitis BLAS in Intel MKL. Primerjava temelji na izmerjenih hitrostih izvajanja operacij. Sistem je implementiran za razširitveno kartico Alveo U250 Data Center. Njegov načrt temelji na sistoličnem polju za množenje matrik, koristi 16-bitno aritmetiko s fiksno vejico in podpira matrike do velikosti 1024 x 1024. Zaradi količine neuporabljenih sredstev po implementaciji je realiziran še drug sistem z dvema identičnima cevovodoma. Njegove arhitekturne značilnosti so enake, a deluje pri malo nižji frekvenci in podpira vršenje dveh operacij hkrati. Zaradi težav s knjižnico Vitis BLAS je za primerjavo uporabljena le knjižnica Intel MKL. Njena zmogljivost množenja matrik z 32-bitnim podatkovnim tipom s plavajočo vejico je izmerjena na Intelovih procesorjih: i7 4700HQ, Xeon Gold 6144, Xeon Gold 6154 in Xeon Platinum 8180. Rezultati kažejo v prid implementiranih sistemov, a je treba upoštevati, da se uporabljen podatkovni tip razlikuje. Bistvo je, da je zmogljivost primerljiva in programsko okolje Vitis zmore proizvesti uporabne rezultate.20202020-09-15 12:10:55Magistrsko delo/naloga120062sl